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[主观题]
下降沿触发的边沿JK触发器在时钟脉冲CP下降沿到来前J=1、K=0，而在CP下降沿到来后变为J=0、K=1，则触发器状态为
答案
1状态
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第5题
图a）所示电路中，位信号信号A及时钟脉冲信号cp如图b））所示，经分析可知，在第一个和第二个时钟脉冲的下降沿时刻，输出Q先后等于：附:触发器的逻辑状态表为（）
A.0,0
B.0，1
C.1,0
D.1,1
第7题
如图7-6-5（a）所示电路中，复位信号、信号A及时钟脉冲信号cp如图7-6-5（b）所示，经分析可知，在第一个和第二个时钟脉冲的下降沿时刻，输出Q先后等于（）
A.0 0
B.0 1
C.1 0
D.1 1
第8题
图7-6-6（a）所示电路中，复位信号、信号A及时钟脉冲信号cp如图7-6-6（b）所示。经分析可知，在第一个和第二个时钟脉冲的下降沿时刻，输出Q分别等于（）
A.0 0
B.0 1
C.1 0
D.1 1
第9题
LDP是什么边沿检测脉冲指令
A.取脉冲下降沿指令，用于下降沿检测运算开始。
B.取脉冲上升沿指令，用于上升沿检测运算开始。
C.与脉冲下降沿指令，用于下降沿检测串联连接。
D.与脉冲上升沿指令，用于上升沿检测串联连接。
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